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研究生近代物理研究所

甘肃省兰州市丨学术研究

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硬件设计非常基础的60个问题 2022-11-25 16:04

当电源输入电压增大或负载过大导致电流异常增大的时候，PTC热敏电阻因为温度增大而使其等效电阻迅速增大，从而使输出电压下降，减小输出电流。当故障去除，PTC热敏电阻恢复到常温，其电阻又变的很小，电源电路恢复到正常工作状态。

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DC-DC科普之几种简单的调压方式 2022-11-25 11:11

电源设计中，环路反馈是非常有意思也是比较难的一个设计要点。我们在应用中，如果需要动态调整电源输出，应该怎么办呢？增加通信接口虽然方便，但是会增加成本，今天介绍几种省成本的方案。

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基于DSP与PC机之间的高速通信设计 2019-09-24 16:26

TMS320VC5416 是TI 的一款16bit 定点高性能DSP，由于VC5416的功耗低、性能高，其分开的指令和数据空间使该芯片具有高度的并行操作能力，在单周期内允许指令和数据同时存取，再加上高度优化的指令集，使得该芯片具有很高的运算速度，同时该芯片本身具有丰富的片内存储器资源以及多种片上外设，因此在工程界得到了广泛的应用。

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开关电源常见电路原理详解 2022-07-30 10:38

开关电源的主要电路是由输入电磁干扰滤波器（EMI）、整流滤波电路、功率变换电路、PWM控制器电路、输出整流滤波电路组成。辅助电路有输入过欠压保护电路、输出过欠压保护电路、输出过流保护电路、输出短路保护电路等。

我快闭嘴

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开关电源基本知识科普 2022-07-28 08:57

个人PC所采用的电源都是基于一种名为“开关模式”的技术，所以我们经常会将个人PC电源称之为——开关电源（Switching Mode Power Supplies，简称SMPS），它还有一个绰号——DC-DC转化器。本次文章我们将会为您解读开关电源的工作模式和原理、开关电源内部的元器件的介绍以及这些元器件的功能。

我快闭嘴

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verilog语言基本语句_verilog语言词汇大全 2018-03-23 11:46

Verilog HDL是一种硬件描述语言（HDL:Hardware Description Language），以文本形式来描述数字系统硬件的结构和行为的语言，用它可以表示逻辑电路图、逻辑表达式，还可以表示数字逻辑系统所完成的逻辑功能。

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verilog是什么_verilog的用途和特征是什么 2018-05-14 14:22

本文首先介绍了verilog的概念和发展历史，其次介绍了verilog的特征与Verilog的逻辑门级描述，最后介绍了Verilog晶体管级描述与verilog的用途。

姚小熊27

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Verilog的语言要素 2017-02-11 17:01

本章介绍Verilog HDL的基本要素，包括标识符、注释、数值、编译程序指令、系统任务和系统函数。另外，本章还介绍了Verilog硬件描述语言中的两种数据类型。 3.1 标识符

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如何高效的编写Verilog HDL？ 2018-02-12 02:22

Vim其实一款Linux系统下常用的编辑器，在Windows下叫Gvim，由于它的高度可定制性，操作命令，使得编程者在编写代码的时候双手甚至可以不用离开键盘，只需要输入相应的命令便可以完成整个编程。可以说是程序员的最爱了。那么我这里为什么推荐使用Gvim来编写VerilogHDL呢，首先就是因为它的高度可定制性。

电子工程师

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FPGA学习verilog代码的经验总结 2018-09-15 09:59

既然HDL设计是并行的，那么就只能各个击破了。我的习惯是先抓几个重要端口，比如时钟(CLK)、复位(RESET)等出现频率比较高的端口，把它先弄清楚，比如时钟是什么频率的?复位是高有效还是低有效?

电子工程师

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Verilog如何编程?Verilog编程知识点总结 2019-01-01 10:13

FPGA的设计就是将自己想要实现的逻辑通过计算机能够理解的语言描述出来，并让计算机根据FPGA内部的资源生成

电子工程师

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FPGA的设计基础之Verilog语言 2019-08-21 15:20

硬件描述语言(HDL)是一种用形式化方法来描述数字电路和系统的语言。数字电路系统的设计者利用这种语言可以从上层到下层(从抽象到具体)逐层描述自己的设计思想，用一系列分层次的模块来表示极其复杂的数字系统。

独爱72H

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Verilog可综合的循环语句 2019-10-13 12:23

Verilog中提供了四种循环语句，可用于控制语句的执行次数，分别为：for，while，repeat，forever。其中，for，while，repeat是可综合的，但循环的次数需要在编译之前就确定，动态改变循环次数的语句是不可综合的。forever语句是不可综合的，主要用于产生各种仿真激励。

电子工程师

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verilog学习要点 2019-07-13 11:04

Verilog HDL (Hardware Description Language) 是一种硬件描述语言，可以在算法级、门级到开关级的多种抽象设计层次上对数字系统建模。它可以描述设计的行为特性、数据流特性、结构组成以及包含响应监控和设计验证方面的时延和波形产生机制。此外，verilog提供了编程语言接口，通过该接口用户可以在模拟、验证期间从外部访问设计，包括模拟的具体控制和运行。

电子工程师

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