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在完成PCB的布局、布线和覆铜工作后，要做些后续处理工作，包括可装配性检查、测试点生成等，而后才能输出可供厂家生产的PCB光绘文件。 一、设计的可装配性检查 设计的可装配性检查就是DFA检查，是检查设计中的元件装配方面问题。检查对象包括：元件间距、引脚跨距、焊盘跨距轴向、过孔及测试点等。在可装配性检查时，PCB设计中与约束不一致时将会以DRC形式标示出来。 在AllegroPCB工作界面中执行Manufacture/DFx check（legacy）命令，弹出Design For Assembly对话框，可进行设计的可装配性检查。
在该对话框中，点击Constraint Setup可对设计的可装配性进行规则设置，如下图，点击Run Audit可根据规则设置进行DFA检查，点击Report即可查看检查报告。
Allegro.doc
(4.79 MB, 下载次数: 4
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最近配置Cadence的共享cis库，按照相关步骤配置完成之后，调用元器件会出现原理图错误，求大佬指教
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